TMS320VC5510AZAV1 定點數(shù)字信號處理器基于 C55x DSP CPU 內(nèi)核。該器件采用C55x?DSP架構(gòu)，通過增加并聯(lián)能力和注重降低功耗來實現(xiàn)高性能和低功耗。

產(chǎn)品：TMS320VC5510AZAV1

核心：C55x

封裝：NFBGA-240

特性：

高性能、低功耗、定點TMS320C55x?；數(shù)字信號處理器 (DSP)

指令周期時間：6.25/5ns

時鐘速率：160/200MHz

每周期執(zhí)行一條/兩條指令

雙乘法器（高達每秒40000萬次乘加運算(MMACS)）

兩個算術/邏輯單元

一條內(nèi)部程序總線

三條內(nèi)部數(shù)據(jù)/操作數(shù)讀取總線

兩條內(nèi)部數(shù)據(jù)/操作數(shù)寫入總線

指令緩存（24K字節(jié)）

160K個16位片上RAM，包括

八塊4K × 16位雙存取RAM (DARAM)（64K字節(jié)）

32塊4K × 16位單存取RAM (SARAM)（256K字節(jié)）

32位外部存儲器接口(EMIF)，帶連接

異步靜態(tài)RAM (SRAM)

異步EPROM

同步DRAM (SDRAM)

同步突發(fā)SRAM (SBSRAM)

16K × 16位片上ROM（32K字節(jié)）

8 M × 16位最大可尋址外部存儲器空間

對六個器件功能域的可編程低功耗控制

片上外設

兩個20位定時器

六通道直接內(nèi)存訪問(DMA)控制器

三個多通道緩沖式串聯(lián)端口 (McBSP)

16位并行增強型主機端口接口 (EHPI)

可編程數(shù)字鎖相環(huán) (DPLL) 時鐘發(fā)生器

八個通用I/O (GPIO) 引腳和專門的通用輸出引腳 (XF)

基于片上掃描的仿真邏輯

IEEE Std 1149.1 (JTAG) 邊界掃描邏輯

240引腳MicroStar BGA?；（球柵陣列）（GGW后綴）

240引腳MicroStar BGA?；（球柵陣列）（ZGW后綴）【無鉛】

3.3 V I/O電源電壓

內(nèi)核電源電壓：1.6V

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